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8cc19c6b5e
commit
b06f500539
@ -1,14 +1,14 @@
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#include "global.h"
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#define GPU_REG_BUFFER_SIZE 0x60
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#define REG_BUFFER_SIZE 0x60
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#define REG_BUF(offset) (*(u16 *)(&gGpuRegBuffer[offset]))
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#define REG_BUFFER(offset) (*(u16 *)(&gGpuRegBuffer[offset]))
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#define GPU_REG(offset) (*(vu16 *)(REG_BASE + offset))
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#define EMPTY_SLOT 0xFF
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extern u8 gGpuRegBuffer[GPU_REG_BUFFER_SIZE];
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extern u8 gGpuRegWaitingList[GPU_REG_BUFFER_SIZE];
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extern u8 gGpuRegBuffer[REG_BUFFER_SIZE];
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extern u8 gGpuRegWaitingList[REG_BUFFER_SIZE];
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extern bool8 gGpuRegBufferLocked;
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extern bool8 gShouldSyncRegIE;
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extern u16 gRegIE;
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@ -21,7 +21,7 @@ void InitGpuRegManager()
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{
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s32 i;
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for (i = 0; i < GPU_REG_BUFFER_SIZE; i++) {
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||||
for (i = 0; i < REG_BUFFER_SIZE; i++) {
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||||
gGpuRegBuffer[i] = 0;
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||||
gGpuRegWaitingList[i] = EMPTY_SLOT;
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}
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@ -35,9 +35,9 @@ static void CopyBufferedValueToGpuReg(u8 regOffset)
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{
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if (regOffset == REG_OFFSET_DISPSTAT) {
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REG_DISPSTAT &= ~(DISPSTAT_HBLANK_INTR | DISPSTAT_VBLANK_INTR);
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REG_DISPSTAT |= REG_BUF(REG_OFFSET_DISPSTAT);
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REG_DISPSTAT |= REG_BUFFER(REG_OFFSET_DISPSTAT);
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} else {
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GPU_REG(regOffset) = REG_BUF(regOffset);
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||||
GPU_REG(regOffset) = REG_BUFFER(regOffset);
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}
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}
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@ -46,7 +46,7 @@ void CopyBufferedValuesToGpuRegs()
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if (!gGpuRegBufferLocked) {
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s32 i;
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for (i = 0; i < GPU_REG_BUFFER_SIZE; i++) {
|
||||
for (i = 0; i < REG_BUFFER_SIZE; i++) {
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||||
u8 regOffset = gGpuRegWaitingList[i];
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||||
if (regOffset == EMPTY_SLOT)
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return;
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@ -58,11 +58,11 @@ void CopyBufferedValuesToGpuRegs()
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void SetGpuReg(u8 regOffset, u16 value)
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{
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if (regOffset < GPU_REG_BUFFER_SIZE)
|
||||
if (regOffset < REG_BUFFER_SIZE)
|
||||
{
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u16 vcount;
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||||
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REG_BUF(regOffset) = value;
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||||
REG_BUFFER(regOffset) = value;
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vcount = REG_VCOUNT;
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if ((vcount >= 161 && vcount <= 225)
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@ -73,7 +73,7 @@ void SetGpuReg(u8 regOffset, u16 value)
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||||
gGpuRegBufferLocked = TRUE;
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||||
for (i = 0; i < GPU_REG_BUFFER_SIZE && gGpuRegWaitingList[i] != EMPTY_SLOT; i++) {
|
||||
for (i = 0; i < REG_BUFFER_SIZE && gGpuRegWaitingList[i] != EMPTY_SLOT; i++) {
|
||||
if (gGpuRegWaitingList[i] == regOffset) {
|
||||
gGpuRegBufferLocked = FALSE;
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return;
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@ -88,9 +88,9 @@ void SetGpuReg(u8 regOffset, u16 value)
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||||
void SetGpuReg_ForcedBlank(u8 regOffset, u16 value)
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||||
{
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||||
if (regOffset < GPU_REG_BUFFER_SIZE)
|
||||
if (regOffset < REG_BUFFER_SIZE)
|
||||
{
|
||||
REG_BUF(regOffset) = value;
|
||||
REG_BUFFER(regOffset) = value;
|
||||
|
||||
if (REG_DISPCNT & DISPCNT_FORCED_BLANK) {
|
||||
CopyBufferedValueToGpuReg(regOffset);
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||||
@ -99,7 +99,7 @@ void SetGpuReg_ForcedBlank(u8 regOffset, u16 value)
|
||||
|
||||
gGpuRegBufferLocked = TRUE;
|
||||
|
||||
for (i = 0; i < GPU_REG_BUFFER_SIZE && gGpuRegWaitingList[i] != EMPTY_SLOT; i++) {
|
||||
for (i = 0; i < REG_BUFFER_SIZE && gGpuRegWaitingList[i] != EMPTY_SLOT; i++) {
|
||||
if (gGpuRegWaitingList[i] == regOffset) {
|
||||
gGpuRegBufferLocked = FALSE;
|
||||
return;
|
||||
@ -120,18 +120,18 @@ u16 GetGpuReg(u8 regOffset)
|
||||
if (regOffset == REG_OFFSET_VCOUNT)
|
||||
return REG_VCOUNT;
|
||||
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||||
return REG_BUF(regOffset);
|
||||
return REG_BUFFER(regOffset);
|
||||
}
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||||
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||||
void SetGpuRegBits(u8 regOffset, u16 mask)
|
||||
{
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||||
u16 regValue = REG_BUF(regOffset);
|
||||
u16 regValue = REG_BUFFER(regOffset);
|
||||
SetGpuReg(regOffset, regValue | mask);
|
||||
}
|
||||
|
||||
void ClearGpuRegBits(u8 regOffset, u16 mask)
|
||||
{
|
||||
u16 regValue = REG_BUF(regOffset);
|
||||
u16 regValue = REG_BUFFER(regOffset);
|
||||
SetGpuReg(regOffset, regValue & ~mask);
|
||||
}
|
||||
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||||
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